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ResistorPrecision Workbench

v0.27.0 안내 · 설계 블록 실습

MOS 공통 소스 · 명시적 게이트 바이어스

입력 증가에 대한 출력 반전과 DC operating point를 확인합니다. 소신호 이득은 지원 AC 조건에서 측정합니다.

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학습 체크는 이 브라우저에만 저장합니다. 엔진의 PASS·실행·제조 판정과 관계없습니다.

시작 전에

따라 하기

  1. 설계 도구 → 통합 설계 → 회로 · 연결 탐색에서 카탈로그를 읽고 회로 template의 MOS 공통 소스 · 명시적 게이트 바이어스 (common_source)를 선택합니다. 새 프로젝트를 생성하거나 아래 예제 ZIP을 가져옵니다.

  2. 회로도에서 root ports와 하위 셀을 엽니다. 아래 기본값·외부 testbench 조건과 실제 연결을 확인합니다.

  3. 외부 gate bias와 drain 부하, IN/OUT·supply current를 확인합니다.

  4. 지원 해석을 선택하고 Simulate를 실행합니다. 결과의 축·단위·실제 run·revision을 읽습니다.

  5. 입력 증가에 대한 출력 반전과 DC operating point를 확인합니다. 소신호 이득은 지원 AC 조건에서 측정합니다.

  6. 한 파라미터만 바꿔 새 해석과 비교합니다. 편집 프로젝트·조건·파형·로그를 같은 revision으로 저장합니다.

포트·기본값·필요한 블록

회로 ID: common_source · 지원 해석: op, ac, tran, dc

포트연결 기준
IN원본 subckt/graph의 핀 순서·역할 확인
OUT원본 subckt/graph의 핀 순서·역할 확인
VPWR원본 subckt/graph의 핀 순서·역할 확인
VGND원본 subckt/graph의 핀 순서·역할 확인
기본 파라미터 (단위는 이름에 포함)카탈로그 값
w_um0.65
l_um0.15
drain_resistance_Ohm10000
gate_bias_V0.7

실제 회로의 모든 하위 셀

이 회로는 하위 셀 없이 primitive로 구성됩니다.

실제 실행 기록 · source와 조건별로

이 표는 사용자의 엔진 상태를 대신하지 않습니다. default·변경 실험·예전 물리 세대를 함께 보존하며 fail/unknown을 pass로 바꾸지 않습니다. 새 실습의 최신 결과는 앱에서 확인하세요.

common_source/default · source 9eb7adb9a008 · 실제 과거 실행

원본 기록 JSON · 프로젝트 a1b825e2bc964828bd2802ce8787d584

실행 파라미터

이름값
w_um0.65
l_um0.15
drain_resistance_Ohm10000
gate_bias_V0.7
단계실행 상태기준 판정run ID
precompletedpass08ea33bd00fd425f9538b4876a34f381

pre · 원본 결과 설명

Actual ngspice op: 1 samples.

결과 revision: 1 · 사용자 현재 프로젝트의 결과가 아닙니다.

측정 이름·단위 원문값
analysisop
x_unitpoint
x_labeloperating point
cornertt
temperature_C27
supply_V1.8
post_layoutfalse
samples1
solverSPARSE 1.3
IN_min0.7
IN_max0.7
OUT_min1.76081041
OUT_max1.76081041
supply_current_min0.0000039189591
supply_current_max0.0000039189591
current_flow_statusavailable
template_idcommon_source
layout_statusnot-generated
metric_sourceactual-ngspice-samples

확인할 결과와 한계

막혔을 때

원문과 재현 자료

지원 범위·자세한 절차 · 검증 당시 template 카탈로그 · 전체 하위 셀·연결 원본 JSON · 해당 generation 실제 실행 기록

다음 실습

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